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Embulkで日本語をお手軽に形態素解析
kuromoji
Embulk
JJUG CCC Fall 2015
Java
#jjug_ccc
フィボナッチを求める回路をneonlightとMessagePack-RPCでFPGAに実装してみた(シミュレーション編)
FPGA
HDL
Vivado
neonlight
フィボナッチを求める回路をSynverllとMessagePack-RPCでFPGAに実装してみた(シミュレーション編)
FPGA
HDL
Vivado
Synverll
DE0 nano SoC(Atlas-SoC)環境構築
FPGA
Atlas-SoC
フィボナッチを求める回路をSynthesijerとMessagePack-RPCでFPGAに実装してみた(ZYNQ編)
Linux
FPGA
zynq
Synthesijer
Vivado
NVIDIA GPUスペック（機械学習用）
CUDA
GPU
機械学習
フィボナッチを求める回路をVHDLとMessagePack-RPCでFPGAに実装してみた(ZYNQ編)
Linux
FPGA
VHDL
MessagePack
zynq
Synthesijerで作ったモジュールをMessagePack-RPCで制御する(ZYNQ論理合成編)
FPGA
MessagePack
zynq
Synthesijer
Vivado
Synthesijerで作ったモジュールをMessagePack-RPCで制御する(IP-Package編)
FPGA
VHDL
MessagePack
Synthesijer
Vivado
MessagePack-RPCを使ってFPGAを制御
FPGA
VHDL
MessagePack
YAPC Asia 2015「Google Cloud Platformの謎テクノロジーを掘り下げる」のまとめ
yapcasia
GoogleCloud
C++ では C言語由来 の多次元配列を使うべき理由がない。
C++
リファクタリング
OpenCV
Eigen
Maker Faire Tokyo 2015のまとめ
Make
Maker
XillinuxをつかってFPGA－ARMプロセッサのデータ通信をしよう
Linux
Ubuntu
FPGA
CPUかGPUか専用回路か
画像処理
GPU
機械学習
FPGA
画像認識
インテル、ISCA 2015でXeon＋FPGAの詳細を公開
FPGA
VerilogのテストにPython製フレームワーク「cocotb」を使う。
Python
Verilog
FPGA
SystemVerilog
UVM
フィボナッチをFPGAで書いてみた
FPGA
Synthesijer
FPGAエクストリーム・コンピューティング第6回が終わりました #fpgax
FPGA
fpgax
AltHDLを雑に紹介する。
FPGA
HDL
SystemVerilog
金融機関のCOBOLに対抗して、産業（工業系）の制御を書いてみるｗ
C
PLC
PID
古典制御
BASIC
FPGAでROSを動かそう
ROS
FPGA
Fluentd対応MIDIキーボードを作ってみた
Fluentd
FPGA
MIDI
IoT
Synthesijer
FPGA未経験者がDE0-Nanoを初めて動かす際にハマりそうなポイント
FPGA
Synthesijer関連資料まとめ
FPGA
Synthesijer
インテルが求める「FPGAアプリケーションエンジニア」とはこんな人
FPGA
OpenCL meets FPGA #2 最適化編
OpenCL
FPGA
OpenCL meets FPGA #1 入門編
OpenCL
FPGA
マイクロソフトはどうやってBingをFPGAで実装したか
Microsoft
bing
FPGA
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